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01
Lab 7 · Loops
이제 루프를 닫는다
pll1~3 → dll1~3 → pi_top. Lab 5·6 의 부품이 하나의 시스템이 되는 순간입니다.
PLLDLLPI

02
PLL
락 = UP/DN 이 사라지는 순간
PFD→CP→필터→VCO→÷N. 제어전압이 평평해지고 출력주기 = N×기준주기가 되면 잠긴 것입니다.
f_out = N·f_refLockAC ch15

03
Loop Filter
극점·영점을 손으로 배치
C 는 적분, 직렬 R 은 영점(위상 회복), 작은 C₂ 는 리플 제거 — 회로이론 s-도메인의 실전.
Zero RRipple C₂PM 60°

04
DLL
주파수는 그대로, 위상만
VCDL = 고리를 닫지 않은 링 VCO. 1차 루프라 안정하고 지터가 누적되지 않습니다 — 하모닉 락만 조심.
Type-INo Jitter Accum.Harmonic Lock

05
PI
눈금 사이를 걷는다
8탭 = 45° 눈금, 가중 합으로 임의 위상 — 보드 skew 보정(Lab 9 PI-cal)의 재료입니다.
45° TapsInterpolation→ Lab 9

06
Spec
락 시간과 지터
로또 속도에서 락 성공 · 정착 시간 · 주기 지터(rms) · Power TT mA — 전 코너.
Lock TimeJitter rmsAll-PVT

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